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Conception conjointe sur FPGA

  • Composante

    ENSEIRB-MATMECA

Code interne

ES9EN319

Description

Module théorique et pratique de conception conjointe sur FPGA. Un projet est mené pendant l'ensemble des séances et permet aux étudiants de dérouler le flot de conception d'un système hétérogène et d'expérimenter les problématiques de la discipline d'un point de vue de l'architecte système embarqué, du développeur VHDL et du développeur logiciel.

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Pré-requis obligatoires

-VHDL pour FPGA
-C/C++
-Architecture des ordinateurs

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Syllabus

-Introduction au Codesign
-Comparaison HW/SW
-Les System On Chip
-L'architecte systeme embarqué
-Le co-design flow
-Le SoftCore microblaze (pipeline, ALU, bus FSL)
-Le design reuse
-Règles de codage VHDL

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Modalités de contrôle des connaissances

Évaluation initiale / Session principale - Épreuves

Type d'évaluationNature de l'épreuveDurée (en minutes)Nombre d'épreuvesCoefficient de l'épreuveNote éliminatoire de l'épreuveRemarques
ProjetRapport1